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1 superpipelining
технология конвейерной обработки
суперконвейеризация
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[Л.Г.Суменко. Англо-русский словарь по информационным технологиям. М.: ГП ЦНИИС, 2003.]Тематики
Синонимы
EN
Англо-русский словарь нормативно-технической терминологии > superpipelining
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2 superpipelining
Вычислительная техника: суперконвейеризация, технология конвейерной обработки команд -
3 superpipelining
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4 superpipelining
вчт.The New English-Russian Dictionary of Radio-electronics > superpipelining
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5 superpipelining
= super-pipeliningкаждая машинная команда ( instruction) проходит через большее число ступеней конвейера (stage), чтобы исполниться быстрееАнгло-русский толковый словарь терминов и сокращений по ВТ, Интернету и программированию. > superpipelining
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6 superpipelining
суперконвейеризация; технология конвейерной обработки команд -
7 super-pipelining
Англо-русский толковый словарь терминов и сокращений по ВТ, Интернету и программированию. > super-pipelining
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8 superpipelined
имеющий конвейер с числом ступеней более пяти или шести. Суперконвейерные архитектуры обычно позволяют использовать более высокие тактовые частоты, чем прочие конвейерные архитектуры.Syn:Англо-русский толковый словарь терминов и сокращений по ВТ, Интернету и программированию. > superpipelined
См. также в других словарях:
Superpipelining — Superpipelining, Pipelining … Universal-Lexikon
superpipelining — A preprocessing technique used by some microprocessors in which two or more execution stages (such as fetch, decode, execute, or write back) are divided into two or more pipelined stages, giving considerably higher performance … Dictionary of networking
MIPS-Architektur — MIPS R4400 Prozessor von Toshiba Die MIPS Architektur (englisch Microprocessor without interlocked pipeline stages; deutsch etwa ‚Mikroprozessor ohne Pipeline Sperren‘) ist eine Befehlssatzarchitektur im RISC Stil, di … Deutsch Wikipedia
MIPS-RISC — MIPS R4400 Prozessor von Toshiba Die MIPS Architektur (Microprocessor without interlocked pipeline stages, etwa „Mikroprozessor ohne Pipeline Sperren“) ist eine RISC Prozessorarchitektur, die ab 1981 von John Hennessy und seinen Mitarbeitern an… … Deutsch Wikipedia
R10000 — MIPS R4400 Prozessor von Toshiba Die MIPS Architektur (Microprocessor without interlocked pipeline stages, etwa „Mikroprozessor ohne Pipeline Sperren“) ist eine RISC Prozessorarchitektur, die ab 1981 von John Hennessy und seinen Mitarbeitern an… … Deutsch Wikipedia
R12000 — MIPS R4400 Prozessor von Toshiba Die MIPS Architektur (Microprocessor without interlocked pipeline stages, etwa „Mikroprozessor ohne Pipeline Sperren“) ist eine RISC Prozessorarchitektur, die ab 1981 von John Hennessy und seinen Mitarbeitern an… … Deutsch Wikipedia
R14000 — MIPS R4400 Prozessor von Toshiba Die MIPS Architektur (Microprocessor without interlocked pipeline stages, etwa „Mikroprozessor ohne Pipeline Sperren“) ist eine RISC Prozessorarchitektur, die ab 1981 von John Hennessy und seinen Mitarbeitern an… … Deutsch Wikipedia
R16000 — MIPS R4400 Prozessor von Toshiba Die MIPS Architektur (Microprocessor without interlocked pipeline stages, etwa „Mikroprozessor ohne Pipeline Sperren“) ist eine RISC Prozessorarchitektur, die ab 1981 von John Hennessy und seinen Mitarbeitern an… … Deutsch Wikipedia
R16000A — MIPS R4400 Prozessor von Toshiba Die MIPS Architektur (Microprocessor without interlocked pipeline stages, etwa „Mikroprozessor ohne Pipeline Sperren“) ist eine RISC Prozessorarchitektur, die ab 1981 von John Hennessy und seinen Mitarbeitern an… … Deutsch Wikipedia
R2000 — MIPS R4400 Prozessor von Toshiba Die MIPS Architektur (Microprocessor without interlocked pipeline stages, etwa „Mikroprozessor ohne Pipeline Sperren“) ist eine RISC Prozessorarchitektur, die ab 1981 von John Hennessy und seinen Mitarbeitern an… … Deutsch Wikipedia
R3000 — MIPS R4400 Prozessor von Toshiba Die MIPS Architektur (Microprocessor without interlocked pipeline stages, etwa „Mikroprozessor ohne Pipeline Sperren“) ist eine RISC Prozessorarchitektur, die ab 1981 von John Hennessy und seinen Mitarbeitern an… … Deutsch Wikipedia
